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設(shè)計(jì)性實(shí)驗(yàn)
　　通信原理課程的設(shè)計(jì)性實(shí)驗(yàn)主要目的是將理論與實(shí)際相結(jié)合，讓學(xué)生根據(jù)給定的技術(shù)要求實(shí)現(xiàn)一些簡(jiǎn)單的通信模塊，為以后的實(shí)際工作預(yù)演。
　　(1)實(shí)驗(yàn)內(nèi)容：主要是按照要求的技術(shù)指標(biāo)，設(shè)計(jì)實(shí)現(xiàn)具有一定功能的通信模塊，比如實(shí)現(xiàn)一個(gè)用于普通電話機(jī)的話音信號(hào)編碼器，或者實(shí)現(xiàn)一個(gè)具有一定增益要求的放大器等。 轉(zhuǎn)貼于 免費(fèi)論文下載中心 http://www.hi138.com 　　(2)實(shí)驗(yàn)方法：模塊仿真和EDA設(shè)計(jì)相結(jié)合。當(dāng)前在實(shí)際通信模塊產(chǎn)品開發(fā)過程中，大多采用Matlab仿真加EDA或DSP設(shè)計(jì)工具實(shí)施，其中DSP工具對(duì)普通高等學(xué)校的學(xué)生來說難度較大，因此一般可考慮采用EDA設(shè)計(jì)工具，條件允許的情況下可為學(xué)生提供EDA和DSP兩種平臺(tái)，學(xué)生可以按照個(gè)人的興趣自愿選擇設(shè)計(jì)手段。譬如卷積編碼模塊的設(shè)計(jì)性實(shí)驗(yàn)，可以采用Matlab對(duì)確定的卷積編碼器進(jìn)行功能仿真，如果仿真和理論分析結(jié)果一致，則說明設(shè)計(jì)思路正確。在這基礎(chǔ)上，再采用EDA開發(fā)系統(tǒng)或DSP開發(fā)系統(tǒng)對(duì)卷積編碼器進(jìn)行系統(tǒng)選型、實(shí)驗(yàn)和測(cè)試，并對(duì)其運(yùn)行速率等性能進(jìn)行分析，以便重新設(shè)置參數(shù)，進(jìn)一步提高它的性能等。該實(shí)驗(yàn)過程可以縮短開發(fā)流程，降低開發(fā)成本，可以使學(xué)生掌握實(shí)際工程的設(shè)計(jì)方法，能更好地為今后的學(xué)習(xí)和工作做準(zhǔn)備。
　　(3)教學(xué)安排：這部分實(shí)驗(yàn)不在實(shí)驗(yàn)教學(xué)學(xué)時(shí)內(nèi)安排，目前主要以兩種形式開展，一是作為畢業(yè)設(shè)計(jì)，二是在高年級(jí)開設(shè)專門的設(shè)計(jì)性實(shí)驗(yàn)課程，此時(shí)學(xué)生相關(guān)的軟硬件知識(shí)已經(jīng)學(xué)習(xí)了，通過設(shè)計(jì)性實(shí)驗(yàn)可以將各種知識(shí)整合，綜合利用。在整個(gè)設(shè)計(jì)性實(shí)驗(yàn)過程中，實(shí)驗(yàn)室對(duì)學(xué)生全天候開放，學(xué)生可以在課余時(shí)間來實(shí)驗(yàn)室進(jìn)行設(shè)計(jì)、制作和調(diào)試。此時(shí)學(xué)生沒有其他因素干擾，可專心投入，收獲較大，且對(duì)后面的就業(yè)非常有利。
　　設(shè)計(jì)性實(shí)驗(yàn)是偏重于應(yīng)用的實(shí)驗(yàn)，通過實(shí)驗(yàn)過程，使學(xué)生具備一定的實(shí)踐能力和創(chuàng)新能力，使實(shí)驗(yàn)教學(xué)真正成為培養(yǎng)學(xué)生實(shí)踐能力的重要環(huán)節(jié)。